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【中天华威】电源ic芯片研发设计工具有哪些
2022-07-04 18:54:00
1)设计输入工具:像Cadence的composer,viewlogic的viewdraw,硬件描述语言VHDL、Verilog HDL是主要设计语言,许多设计输入工具都支持HDL。另外像Active—HDL和其它的设计输入方法,包括原理和状态机输入方法,设计 FPGA/CPLD的工具大都可作为IC设计的输入手段,如Xilinx、Altera等公司提供的开发工具,Modelsim FPGA等。
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Verilog—XL、NC—verilog用于Verilog仿真,Leapfrog 用于VHDL仿真,Analog Artist用于模拟电路仿真。Viewlogic的仿真器有:viewsim门级电路仿真器,speedwaveVHDL仿真器,VCS— verilog仿真器。Mentor Graphics有其子公司Model Tech 出品的VHDL和Verilog双仿真器:Model Sim。Cadence、Synopsys用的是VSS(VHDL仿真器)。现在的趋势是各大EDA公司都逐渐用HDL仿真器作为电路验证的工具。
3)综合工具:综合工具可以把HDL变成门级网表。这方面Synopsys工具占有较大的优势,它的Design Compile是综合的工业标准,它还有另外一个产品叫Behavior Compiler,可以提供更的综合。此外,美国还出了一家软件叫Ambit,比Synopsys的软件更有效,可以综合50万门的电路,速度 更快。不过Ambit已被Cadence公司收购,为此Cadence放弃了它原来的综合软件Synergy。
随着FPGA设计的规模越来越大,各EDA 公司又陆续开发了用于FPGA设计的综合软件,比较有名的有:Synopsys的FPGA Express,Cadence的Synplity,Mentor的Leonardo,这三家的FPGA综合软件占了市场的绝大部分。
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